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#freeze
#norelated
* ご挨拶 [#ra13f821]
我が社(有限会社赤葉ロジック→以下"RLL"と表示)の活動内容をご理解いただくために、ある程度の技術内容を継続的に技術メモとして公開して行きます。
我が社(有限会社赤葉ロジック→以下"RLL"と表示)の活動内容をご理解いただくために、ある程度の技術内容を継続的に技術メモとして公開して行きます。ただし技術メモの公開条件は、apache2ライセンスです。
/----------------------------------------------------------------------------/
/ Copyright 2008 有限会社赤葉ロジック /
/Apache License Version 2.0（「本ライセンス」）に基づいてライセンスされます。/
/あなたがこのファイルを使用するためには、本ライセンスに従わなければ /
/なりません。本ライセンスのコピーは下記の場所から入手できます。 /
/ http://www.apache.org/licenses/LICENSE-2.0 /
/適用される法律または書面での同意によって命じられない限り、本ライセンスに /
/基づいて頒布されるソフトウェアは、明示黙示を問わず、いかなる保証も /
/条件もなしに「現状のまま」頒布されます。本ライセンスでの権利と制限を /
/規定した文言については、本ライセンスを参照してください。 /
/----------------------------------------------------------------------------/
** systemVerilog [#l2d2fc46]
*** 簡単な説明 [#oa31e22d]
*** 技術メモ [#p33c0828]
- [[randomize()の威力をグラフにしてみる]]
randomaize()てそんなに便利？？と思ったので数値化しグラフにしてみた。
回路はお手軽にcase文で作成、順番による調停回路20bit（ラウンドロビン）ただしクロック毎に調停する RTLは下記参照
* FPGA [#r493dc31]
カバレッジ値の変化を見たいだけなのでアサーションはovlのassert_zero_one_hotのみ付けといた。
&size(20){''目次''};
#contents
結果は冒頭のグラフにあるとおりrandomパターンを80個生成でカバレッジ１００％達成。結構収束が速い。。回路の性格で？？
randomize()を使用した回路検証の雰囲気が何となくつかめた。
#ref(arbitr_cov.jpg)
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